ตัวกรอง

การค้นหาล่าสุดของฉัน
คัดกรองโดย:
งบประมาณ
ถึง
ถึง
ถึง
ประเภท
ทักษะ
ภาษา
    สถานะงาน
    4,395 verilog vhdl งานที่พบ, การเสนอราคา USD
    test-bench for VHDL module 6 วัน left
    ยืนยันแล้ว

    I need the test bench working with modelsim to validate the module has been written in vhdl. The test bench needs to check the working stage of module.

    $15 / hr (Avg Bid)
    $15 / hr การประมูลเฉลี่ย
    10 คำเสนอราคา

    microcontroller programs employing peripherals ADC and PWM peripherals Scheduling and concurrency using FSM RTOS Wireless systems and IoT State machines( Verilog) Digital Design using Verilog and software Programming FPGAs Embedded processors

    $243 (Avg Bid)
    $243 การประมูลเฉลี่ย
    18 คำเสนอราคา
    $118 การประมูลเฉลี่ย
    2 คำเสนอราคา

    Looking for help on an adder project in verilog

    $24 (Avg Bid)
    $24 การประมูลเฉลี่ย
    11 คำเสนอราคา
    System Verilog Project -- 2 2 วัน left
    ยืนยันแล้ว

    Hi, I am looking to optimize my current system verilog code. Please let me know if you have experience implementing optimization techniques in System Verilog.

    $25 (Avg Bid)
    $25 การประมูลเฉลี่ย
    13 คำเสนอราคา
    VHDL and Xilinx Project 4 วัน left

    Hello, you've sent me a message earlier about a project in Xilinx and VHDL, are you still available?

    $68 (Avg Bid)
    $68 การประมูลเฉลี่ย
    1 คำเสนอราคา
    Verilog Project in MODELSIM 17 ชั่วโมง left

    Modul de inmultire, folosind sumator si registrii de deplasare

    $122 (Avg Bid)
    $122 การประมูลเฉลี่ย
    11 คำเสนอราคา
    Verilog Project 14 ชั่วโมง left

    I have a project about implementing a Datapath and a Controller FSM for Fibonacci Series Calculator on Quartus and Modelsim.

    $28 (Avg Bid)
    $28 การประมูลเฉลี่ย
    9 คำเสนอราคา
    SystemVerilog synthesizable Code หมดเขตแล้ว left

    Need someone to Recheck my Verilog Code for PipelineDesign

    $94 (Avg Bid)
    $94 การประมูลเฉลี่ย
    5 คำเสนอราคา

    I am looking to hire someone to go through the vitter algorithm of the dynamic huffman coding and implement the encoder(compulsory) and decoder(optional) . I am willing to explain you the details of the algorithm in depth once we connect . there are several articles that I have referred to but the wikipedia description is pretty accurate so I provide the link here. There is a visual representation of the same algorithm in the other links and some accompanying text explaining. You are required to go through the vitter algorithm and implement the same. Links : 1) 2)

    $137 (Avg Bid)
    $137 การประมูลเฉลี่ย
    4 คำเสนอราคา
    $90 การประมูลเฉลี่ย
    8 คำเสนอราคา
    Modify the Code of Simple SPI Master in Verilog หมดเขตแล้ว left

    I have written the code for a simle SPI Master in verilog and also included a testbench. I want you to: 1) Add a Clock Divider to it, so that the output SPI frequecy is 1MHz 2) There are 3 SPI commands: (1) one write command, (2) multiple write command, (3) one read command. Modify the SPI master Verilog code to implement these 3 commands. Ideally, I want to specify (i) write or read, (ii) number of bytes if write command, (iii) address, (iv) data, then the code will automatically generate the correct checksum and dummy bytes. Would appreciate if the work could be finished as soon as possible. Thanks!

    $9 (Avg Bid)
    $9 การประมูลเฉลี่ย
    5 คำเสนอราคา
    VERILOG RTL CODE for Interface arbiter หมดเขตแล้ว left

    2 interface accessing the arbiter through clock crossing using a config register. More details will be shared later.

    $23 (Avg Bid)
    $23 การประมูลเฉลี่ย
    6 คำเสนอราคา
    Computer Architecture หมดเขตแล้ว left

    Need to code in ARMv7 and VHDL. Questions would be tough

    $100 (Avg Bid)
    $100 การประมูลเฉลี่ย
    6 คำเสนอราคา
    Need help with VHDL หมดเขตแล้ว left

    Need help to code for a hamming coder. Please let me know if you can do it.

    $20 / hr (Avg Bid)
    $20 / hr การประมูลเฉลี่ย
    8 คำเสนอราคา
    CADENCE VIRTUOSO making circuit from verilog-a หมดเขตแล้ว left

    i have a code for tfet using verilog-a,i need to get a circuit from verilog-a in cadence virtuoso and design digital circuit,half adder and ring oscilator

    $20 (Avg Bid)
    $20 การประมูลเฉลี่ย
    3 คำเสนอราคา

    Design, simulate and verify a synchronous digital system that detects and recognizes your student ID as password that can be used to generate an output signal. The student ID is entered to the system sequentially and synchronized to the master clock for proper operation of the system. The system is expected to generate an output logic High for 3 clock cycles if the ID sequence is detected correctly. The system will then return to the wait state, where it waits for a new sequence to be entered by user. Use any of the student ID from the group members in this design. You are free to add any additional features to your system as deemed appropriate.

    $5 / hr (Avg Bid)
    $5 / hr การประมูลเฉลี่ย
    10 คำเสนอราคา
    Expert in python and Verilog/VHDL needed หมดเขตแล้ว left

    I need someone expert in python and Verilog/VHDL

    $156 (Avg Bid)
    $156 การประมูลเฉลี่ย
    9 คำเสนอราคา
    FPGA Image processing -- 3 หมดเขตแล้ว left

    hi i want to create one image processing code for attached images . final image has different. This small dot can be any where in this white line . can you do this? code should have to find this dot in blue red ,yellow etc apart from can use only Verilog or VHDL here please send your price for this and time . Then we can start.

    $650 (Avg Bid)
    $650 การประมูลเฉลี่ย
    6 คำเสนอราคา
    $245 การประมูลเฉลี่ย
    4 คำเสนอราคา
    I need help -- 2 หมดเขตแล้ว left

    Hi, I need help with, Single cycle data-path design of CPU with assembly code in Verilog.

    $8 - $23
    $8 - $23
    0 คำเสนอราคา
    Need VHDL Expert หมดเขตแล้ว left

    Need a VHDL Expert designing processors

    $103 (Avg Bid)
    $103 การประมูลเฉลี่ย
    9 คำเสนอราคา
    Need an expert in VHDL with processor logic design หมดเขตแล้ว left

    Need an expert in VHDL with Microprogrammed control unit and hardwired control unit design for a 1 bit processor

    $93 (Avg Bid)
    $93 การประมูลเฉลี่ย
    9 คำเสนอราคา
    $130 การประมูลเฉลี่ย
    18 คำเสนอราคา
    Hardware implementation of Neural network หมดเขตแล้ว left

    Need to implement neural network testing on verilog. Need verilog coding. Training and testing done in matlab. And then testing part again done in verilog. And then compare the computational time of matlab and verilog

    $67 (Avg Bid)
    $67 การประมูลเฉลี่ย
    1 คำเสนอราคา
    Define a transmitter module in Verilog หมดเขตแล้ว left

    I need help to Define a transmitter module in Verilog using VHDL. I will provide more details in chat.

    $80 (Avg Bid)
    $80 การประมูลเฉลี่ย
    11 คำเสนอราคา
    I need a VERILOG EXPERT หมดเขตแล้ว left

    Verilog needed for this project. A developer to work quick

    $33 / hr (Avg Bid)
    $33 / hr การประมูลเฉลี่ย
    4 คำเสนอราคา
    Lattice_CPLD_verilog หมดเขตแล้ว left

    Need help with Lattice CPLD Verilog design - - simple power sequencing, GPIO registers control, I2C, RS232

    $3141 (Avg Bid)
    $3141 การประมูลเฉลี่ย
    13 คำเสนอราคา
    Build an 8-bit microprocessor in VHDL หมดเขตแล้ว left

    Design an 8 bit microprocessor in VHDL with two execution stages: fetch and execute. There are two shared buses, one for address and one for data. Both the buses are connected to an external memory. There is a pdf attached which provides a more information and the expected structure of the microprocessor. Any other questions please ask in chat.

    $140 (Avg Bid)
    $140 การประมูลเฉลี่ย
    6 คำเสนอราคา
    $20 การประมูลเฉลี่ย
    5 คำเสนอราคา
    Verilog/System Verilog microproject -- 3 หมดเขตแล้ว left

    These are just 3 simple questions needed to be completed on the topic of sequential circuits in Verilog. I have to submit this in 2 hours, so if you can do it quickly please accept this offer it is very simple.

    $15 (Avg Bid)
    $15 การประมูลเฉลี่ย
    3 คำเสนอราคา

    Control DC motor by pulse frequency modulation (PFM) IN VHDL . I want code and testbench for Dc motor pwm by vhdl and using fpga Model of fpga kit ( DE10-Lite) End of the project I need a report

    $41 (Avg Bid)
    $41 การประมูลเฉลี่ย
    5 คำเสนอราคา
    Design an ALU Using Verilog -- 2 หมดเขตแล้ว left

    Top cell : alu I/O: bit 15 is the most significant bit. INPUTS: A(15:0) , B(15:0) , alu_code(4:0) ; OUTPUTS: C(15:0) overflow TOP MODULE: 16-bit Adder Module PRIMARY SIGNALS: BUS inputs/outputs and additional signals BUS signals: bit 15 is the most significant bit. All bus signals are named with upper case letters INPUTS: A[15:0], B[15:0],CODE[2:0] OUTPUTS: C[15:0] More details in Chat!

    $121 (Avg Bid)
    $121 การประมูลเฉลี่ย
    15 คำเสนอราคา
    Investigating Hardware Debugging Assistance หมดเขตแล้ว left

    We are a research gr...working human study involving debugging assistance for Verilog designs. The study involves asking designers to debug mistakes in circuit descriptions, either with or without some form of debugging assistance. The debugging hints can take the form of highlighting the wire or register name with the bug, or highlighting several lines of code likely containing the bug. We are hoping to figure out what forms of debugging assistance work best in helping hardware designers fix mistakes efficiently, and eventually hope to integrate our findings into a learning tool aimed at teaching novices how to write Verilog descriptions. The study is expected to take around 45 minutes to an hour to complete, and we will compensate people familiar with Verilog $25 for...

    $10 - $30
    $10 - $30
    0 คำเสนอราคา
    I need VHDL Designer หมดเขตแล้ว left

    This is a final year project. We are struck with simulation. Need to debug our program, or else develop the project from scratch. I am attaching the code that we have wrote for your reference. We used Quartus altera for coding, and model sim for simulation. The development board is a cyclone 2. There were no errors as such. The code would simulate and after one clock cycle, the output would become 'Z'. From what I understood, the main issue is the interconnection between all the modules.

    $123 (Avg Bid)
    $123 การประมูลเฉลี่ย
    3 คำเสนอราคา
    vlsi design using vhdl,verilog หมดเขตแล้ว left

    i have design some circuits and i need implement using magic also need test using irsim from () i have a pdf file to describe everything you should do , text me for more .

    $216 (Avg Bid)
    $216 การประมูลเฉลี่ย
    6 คำเสนอราคา
    PWM generator HDL verilog zynq7020 zturn board หมดเขตแล้ว left

    I need a pwm generator for vivado 2020.2 running on a zturn board 7020, complete of tcl scripts for ip creation, sim files and constraints

    $215 (Avg Bid)
    $215 การประมูลเฉลี่ย
    5 คำเสนอราคา
    VHDL Designer หมดเขตแล้ว left

    This project requires the student to implement a 10-bit counter design using VHDL. The counter will have the ability to count up and down from 0 and 1000. This requires the utilization of 16 slide switches and the center push button of the Basys3 board. The 10 right-most switches (SW0 – SW9) will be used to input a preset value to the counter or the ALU. SW0 represents the LSB and SW9 represents the MSB of the input value. The center push button (BTNC) is used as the manual clock for the counter. The count should increase or decrease (depending on the selector switch, SW13) by 1 on every rising edge of this button.

    $152 (Avg Bid)
    $152 การประมูลเฉลี่ย
    12 คำเสนอราคา
    VHDL multiplexer code หมดเขตแล้ว left

    Using ISE design suite. Design an 8-Bit ALU (x and y are inputs and Result is output), based on modular arithmetic and logic circuits and 8x1 line multiplexer, in VHDL. Add comments to your code whenever required. Design a test bench to verify your designed circuit functionality. Add simulation results screen shot. ** I will share more details if you will do it

    $50 (Avg Bid)
    $50 การประมูลเฉลี่ย
    3 คำเสนอราคา
    VLSI VHDL OR VERILOG หมดเขตแล้ว left

    Implement your design using Magic VLSI layout tool to generate your project layout Test your design using irsim to simulate your project. Reqired Magic VLSI tool is running on ubuntu OS SRAM PROJECT VLSI

    $150 (Avg Bid)
    $150 การประมูลเฉลี่ย
    4 คำเสนอราคา

    I need help with my project. You must be good at RISC-V and Verilog. The project is related to Cache. Please check the file

    $27 (Avg Bid)
    $27 การประมูลเฉลี่ย
    2 คำเสนอราคา

    i need help in Implement MIPS processor pipeline and instruction and data caches, using VHDL. i will provide more details in the chat.

    $50 - $51
    $50 - $51
    0 คำเสนอราคา
    Fractal image compression in vhdl หมดเขตแล้ว left

    hi everyone, I need a fractal image compression code (for a 128*128 image) implemented on a DE2 cyclone II in the M4K memory which has 105 blocks.

    $143 (Avg Bid)
    $143 การประมูลเฉลี่ย
    3 คำเสนอราคา
    Verilog/System Verilog microproject -- 2 หมดเขตแล้ว left

    This is a simple project in Verilog using System Verilog features as well. We are given the base sv file with a testbench as well, we just have to complete the file with the required code to complete the project.

    $25 (Avg Bid)
    $25 การประมูลเฉลี่ย
    1 คำเสนอราคา
    Write a verilog code and show a presentation หมดเขตแล้ว left

    write codes and the screenshot of your schematic in a text file. Then you have to make a video presentation

    $30 (Avg Bid)
    $30 การประมูลเฉลี่ย
    4 คำเสนอราคา
    $19 / hr การประมูลเฉลี่ย
    7 คำเสนอราคา
    FPGA4student หมดเขตแล้ว left

    This VHDL project is to design and implement noise filtering, metastabiliy and synchronization of given signals

    $222 (Avg Bid)
    $222 การประมูลเฉลี่ย
    5 คำเสนอราคา
    Dc motor pwm , vhdl using fpga -- 4 หมดเขตแล้ว left

    I want program code and testbench for Dc motor pwm by vhdl and using fpga Model of fpga kit ( DE10-Lite) and I hope all of these including in the report also simulation in one report

    $57 (Avg Bid)
    $57 การประมูลเฉลี่ย
    6 คำเสนอราคา
    vhdl encoder หมดเขตแล้ว left

    I am looking for a real-time A-law/U-law encoder written in VHDL for implementing in a Lattice XP2 FPGA. The input to the encoder will be 16 bit PCM16, the output will be 8 bit a-law/U-law. The PCM16input will comprise of 24 channels. The CODEC will have 1 16 bit input. The 2k channels will be fed into the codec sequentially in blocks of 32 16bit samples. The CODEC shall handle a total of 10 Megasamples/second in real time. Each block of 32 16bit PCM data will be accompanied with a 4 bit channel number 0-23. The 8 bit companded output should have an extra 4 bit output that will hold the channel address that corresponds to the PCM channels from which it was created. The target FGA is a Lattice XP2-8 but the code will be demonstrated in the Lattice XP5 eval board as attached.

    $2125 (Avg Bid)
    $2125 การประมูลเฉลี่ย
    2 คำเสนอราคา